第21讲.数字电路设计--状态机(下)
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适合人群
基础语言Verilog HDL,本课程面向0基础,适合对芯片IC行业感兴趣或想进入、转行数字芯片验证、设计等岗位的同学。
你将会学到
将学员设计语言障碍清扫干净,同时为大家更好的开展验证,以及后面的设计代码debug打下基础。
- 达到设计入门的程度
- 清扫干净设计语言障碍
- 为后面的设计代码debug打下基础
课程简介
常见问题
问:Q:我是0基础,可以学吗?
答:A:我们的这个课程真正的0基础起步,课程内容涉及基础知识的点拨和串讲,包括但不限于数字电路基础、Linux操作系统下基础操作等。并且加入了C语言课程和C++课程,扫除一切学习基础障碍。在学习过程中再做到多学多练,参考随堂代码跟着老师一起练习,并且在答疑群老师也会事无巨细的给大家解答问题,参考我们其他课程,学员在群里积极交流,学习氛围超级好,大家一起交流,一起进步。
问:Q:老师,验证目前的行业薪酬区间大概是多少?
答:A:其实稍微去搜索一下数字芯片验证工程师招聘的条件,就能得到答案。
保守的说,刚毕业的985、211的硕士应届生,在一线城市,能达到40w~60w的年薪。普通院校的基本上至少也在20w以上了,而且当下,确实验证非常缺人
问:Q:老师,verilog应该咋学呀,学到什么程度呢?
答:A:Verilog HDL作为芯片设计的必备语言,对我们验证而言,设计是我们验证的对象,所以一定要掌握设计的基础语法,所以低要求是能看懂Verilog HDL的语句,高要求肯定是越深越好,本身我们花了很多课时开始讲起的,基本上跟上课程节奏就可以了。而且我们在课程中加入了C语言/C++课程,如果有了这些基础再去学verilog会更容易和轻松。
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- 第一章 第3部分:Verilog HDL入门(9-26)
- 1-1试看 第9讲.Verilog HDL模块(module)认知47:10
- 1-2试看 第10讲.Verilog HDL设计--assign语句36:39
- 1-3第11讲.Verilog HDL设计--assign语句实操53:36
- 1-4第12讲.Verilog HDL设计-always语句(上)25:50
- 1-5第13讲.Verilog HDL设计-always语句(下)11:49
- 1-6第14讲.Verilog HDL设计always语句实操48:58
- 1-7第15讲.Verilog HDL建模方式48:20
- 1-8第16讲.Verilog HDL其他常见语法38:43
- 1-9第17讲.Verilog HDL代码风格46:10
- 1-10第18讲.高性能数字电路设计基础28:56
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